压差只剩几十毫伏：核压 LDO 的瞬态别在标称余量下验收

资讯导读 · 来源：电子产品世界（原文：重新定义 AI 和高性能数字系统中快速变化负载下的 LDO 极限，2026-10-22）

AI 加速器、高速 ADC/DAC 和 FPGA 的负载会在亚微秒里跳变，上游 DC/DC 又把压差压到只剩几十毫伏。原文把问题收在这个工况：许多 LDO 一贴近压差，环路带宽下降、输出阻抗升高，负载阶跃造成的跌落就不再按标称条件外推。文中以安森美 T30LMPSR131、T30LMPSR165 为例，说明独立偏置的 NMOS 稳压器可以在极低压差下仍保持动态性能。

工程师可抓的 3 个决策点

1. 验收余量写成「几十毫伏」，不要停在标称压差：数字核经常只比输出高几十毫伏。环路和跌落要在这个余量下重测，标称条件下的 PSRR 或静态精度不能代替。
2. 大电流核压和小电流时钟轨分开选：T30LMPSR131 为 1A 级 NMOS LDO，用独立偏置保住栅极驱动，1A 时典型压差约 25mV。T30LMPSR165 为 300mA 级，典型压差约 26mV，面向 ADC、PLL、SerDes；原文给出从零到满量程约 100ns 上升、稳定时间低于 1μs，输出电容可低至 1μF。
3. 余量收到约 100mV 时先看下冲和恢复：原文称此时相对竞品的峰值下冲和稳定速度差距更明显。核压跌落会吃时序裕量，转换器电源扰动会吃线性度和抖动，两张表分开收。

原文：https://www.eepw.com.cn/article/202610/484152.htm

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本稿为资讯导读；压差、下冲与稳定时间以原文实测及最新规格书为准。